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Verilog HDL行为建模--- 顺序语句块

7.2 顺序语句块
语句块块提供将两条或更多条语句组合成语法结构上相当于一条语句的机制。这里主要讲
Verilog HDL 的顺序语句块(begin . . . end) :语句块中的语句按给定次序顺序执行。
顺序语句块中的语句按顺序方式执行。每条语句中的时延值与其前面的语句执行的模拟时间
相关。一旦顺序语句块执行结束,跟随顺序语句块过程的下一条语句继续执行。顺序语句块的语
法如下:

begin
[ :block_id{declarations} ]
procedural_statement ( s )


end

例如:
/ / 产生波形:
begin


#2 Stream = 1;
#5 Stream = 0;
#3 Stream = 1;
#4 Stream = 0;
#2 Stream = 1;
#5 Stream = 0;


end

2004-08-16 第35页,共41页
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假定顺序语句块在第1 0 个时间单位开始执行。两个时间单位后第1 条语句执行,即第12 个时
间单位。此执行完成后,下1 条语句在第17 个时间单位执行(延迟5 个时间单位)。然后下1 条语句
在第2 0 个时间单位执行,以此类推。该顺序语句块执行过程中产生的波形如图:


图11 顺序语句块中积累延时



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