立即可用的解决方案无缝地将Virtualizer 虚拟原型验证和HAPS基于FPGA的原型验证整合在一起，以加速SoC软件和硬件的开发
亮点：
- 通过一种混合原型同时获得两个领域的最佳技术，即无缝地将虚拟原型与基于FPGA的原型连接在一起
- 可更早地开始多核系统级芯片（SoC）的原型验证，并实现系统级模型的高性能执行，它同时通过硬件接口与外界实时链接
- 在虚拟与基于FPGA原型环境之间将SoC的不同设计单元进行分割，以使整个原型的性能最大化
- 通过对新的设计单元使用虚拟原型技术，以及对已有的逻辑使用基于FPGA的原型技术，加速系统的快速形成
- 在基于Virtualizer的环境中，改善除错可见度和对开发软件的控制
可方便地将高性能ARM Cortex处理器模块、ARM AMBA互联事务处理器和Synopsys DesignWare IP，与您设计的其它部分一起集成到一个混合原型之中
新思科技公司日前宣布了一种集成化混合原型验证解决方案，它将Synopsys的Virtualizer虚拟原型验证和Synopsys基于FPGA的HAPS原型验证结合在一起，以加速系统级芯片（SoC）硬件和软件的开发。通过对新设计的功能使用Virtualizer虚拟原型技术和对重用逻辑使用基于FPGA的HAPS原型技术，设计师能够将设计周期中软件开发的起始时间提前多达12个月。此外，Synopsys的混合原型设计解决方案可确保设计师加速对硬件/软件的集成及系统验证，显著缩短了整体的产品设计周期。凭借ARM Cortex处理器的高性能模型、基于ARM AMBA协议的事务处理器以及DesignWare IP，开发者可为了最贴近他们的设计需求，而方便地将其基于ARM处理器的设计进行分割分别进入到虚拟的和基于FPGA的原型中。
目前，设计师在构建SoC原型时使用两种相对独立的方法：基于事务级模型（TLM）的虚拟原型验证和基于FPGA的原型验证。虚拟原型验证通过执行快速TLM而完美地适用于在没有RTL时加快的软件开发，并提供了更高效的纠错和脚本分析。基于FPGA的原型设计可提供周期精准和高性能的执行，以及直接真实接口连接。Synopsys的混合原型设计解决方案将Virtualizer虚拟原型和HAPS基于FPGA原型两者的优势精心调和在一起，以使软件开发和系统集成能在项目周期中更快完成。
Synopsys的混合原型验证解决方案增强了软件栈验证，这是因为通过使用Virtualizer虚拟原型可带来非常高的处理器执行速度。它通过模拟PHY或测试设备直接连接到真实世界，该I/O模型接口叠加在基于FPGA的HAPS上。此外，设计师把已有的RTL 或IP用在基于FPGA的原型和把新功能用在SystemC事务级模型中，这样的方法在项目开发中可以更快地执行和更早地实现。
Synopsys的高性能HAPS通用多资源总线（UMRBus）物理连接，可高效地在虚拟和基于FPGA原型验证两种环境之间传输数据。预先验证的、基于HAPS的事务处理器可支持ARM AMBA 2.0 AHB/APB、AXI3、AXI-4和AXI4-Lite互联，它为设计师在虚拟或基于FPGA的原型验证环境之间分割SoC设计提供了很大的灵活性，分割可在AMBA 互联的通常的模块级边界进行。与传统基于FPGA的原型设计相比，使用混合原型中的基于Virtualizer环境的软件纠错能力，用户对正在开发的软件的寄存器和存储器文件拥有更大的可见度和控制能力。
